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» 2011年11月25日 00時00分 UPDATE

FPGA Insights:第44回 組み込みシステム設計者のニーズに応える最新SoC FPGA(後編)

システム・レベルの機能をワンチップに集積する手法として、FPGAの活用が注目されている。とくに、高性能プロセッサを内蔵したSoC FPGAが登場したこともあり、その動きに弾みを付ける。こうしたSoC FPGAを有効活用するには、ハードウェアの開発環境と並んで、ソフトウェア開発を容易にするツールのサポートが重要となる。本稿ではソフトウェアの開発効率を高めることができる「仮想プロトタイピング環境」など、最新のソフトウェア開発環境について紹介する。

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ハード/ソフト開発環境を強化

 前編でも述べたように、アルテラはARMベースの「SoC FPGA」ファミリとその「シミュレーション・モデル」を2011年10月に発表した(プレスリリース1プレスリリース2EE Times Japanニュース)。今回のSoC FPGAファミリは、28nm世代のローエンドファミリ「Cyclone® V」およびミッドレンジファミリ「Arria® V」をベースとした製品である。いずれも最大800MHzで動作するデュアルコア構成の「Cortex-A9 MPCore」プロセッサを中核としたSoCを構成することができる。NEONメディア・プロセッサ・エンジン、単精度/倍精度浮動小数点演算回路、L1およびL2キャッシュ、ECC付きメモリ・コントローラ(DDR2/3、Mobile DDR、LPDDR2、NANDフラッシュなど)やUSB 2.0などの汎用ペリフェラルといった周辺回路も含まれている。

 アルテラは、このARMベースの「SoC FPGA」ファミリの製品化にあわせて、ハードウェア/ソフトウェア開発環境の強化・拡充も進めてきた。これまでハードウェア開発環境として提供してきた「Quartus® II」に、システム・レベル統合ツール「Qsys」を追加した。Qsysは、FPGAに最適化されたスイッチベースのネットワーク「Network-on-a-Chip(NoC)」アーキテクチャを採用している。しかも、IPコアとサブシステムを接続するインタコネクト・ロジックを自動的に生成することができるため、SoC FPGAの設計期間を短縮し、設計者の労力軽減も可能となる。また、Qsysはパイプライン・レジスタの自動挿入を可能とする機能を備えており、従来のSOPC Builderに比べて、最大2倍の動作周波数を実現することができる。

これ以外にも、Qsysには次世代SoC FPGA設計に必要な機能がいくつか追加されている。その1つが、階層構造設計のサポートである。この機能により、IP機能のコレクションをサブシステムとして再利用しやすくなり、大規模なシステム開発やスケーラブルなシステム拡張がこれまで以上に容易に行えるようになる。

また、業界標準のバス・インタフェースをサポートしていることである。最新のQuartus II開発ソフトウェアでは、アルテラがこれまでサポートしてきたインターコネクト・ファブリック「Avalon」に加えて、「AMBA AXI」など、業界標準のオンチップバスにも対応しており、さまざまなバス仕様のIPコアをFPGA上で混載して利用することが可能となる。

仮想プロトタイピング環境をサポート

 ARMベースの「SoC FPGA」ファミリ向けソフトウェア開発環境としては、ARM社から提供されるエコシステムを利用することができる。それに加えて、SoC FPGAデバイスのハード・プロセッサ・システムをPC上で仮想化した「Virtual Target」の提供を新たに始めた(図1)。このVirtual Targetは、シノプシス社が既に供給している仮想プロトタイピング環境をベースとしたもので、開発ボードを置き換えてソフトウェア開発を実施することができるツールである。

図1:Virtual Targetの概要 図1:Virtual Targetの概要

 Virtual Targetで最初に提供されるターゲット・ボードは、デュアルコアのARM Cortex-A9 MPCoreプロセッサとその周辺機能から構成される「ハード・プロセッサ・システム」をモデル化したものとなる。DDR SDRAMやフラッシュメモリ、バーチャルI/Oなど、ボード・レベルのコンポーネントもモデル化されて内蔵されている。

 このシミュレーション・モデルは、SoC FPGAデバイスと同等の機能を備えており、かつバイナリレベルおよびレジスタレベルでの互換性を持つ。また、Virtual Targetのモデル上で、「Linux」や「VxWorks」といったOSを起動させることもできる。SoC FPGAに実装されたハードIPに対するデバイス・ドライバも含まれているため、実機が完成していない状態でも、Virtual Targetを用いれば容易にソフトウェアの開発と検証が可能となる。しかも、Virtual Target上で開発したソフトウェアを、そのまま実機に移行させることができる。

 また、Virtual Targetの拡張機能「FPGAイン・ザ・ループ」を追加提供する予定である。このFPGAイン・ザ・ループを利用すれば、FPGA上のユーザーIP用のドライバ開発やハード・プロセッサ・システムとFPGAロジックとの協調検証をモ行うことができる。

まとめ

 Virtual TargetとFPGAイン・ザ・ループを組み合わせて利用すれば、最終的にハードウェアの完成を待たなくても、組み込みソフトウェアの開発を先行して進めることができる。このような開発ツールを利用できることは、タイムツーマーケットが強く要求される最近の組み込みシステム開発において、大きなメリットといえよう。なお、Virtual Targetの操作については、アルテラのウェブサイトで公開されているデモ動画でも確認することができる 。

公開中(2011年2月〜2012年1月掲載分)

第27回 Altera社、28nmのFPGA製品群を拡充 さまざまなシステムの要求に対応

第28回 FPGAの組み込み開発最前線(前編)

第29回 FPGAの組み込み開発最前線(後編)

第30回 「システム設計者の選択肢を広げるSoC FPGA」(前編)

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第34回 こんなに使える!CPLD活用術(前編)

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第38回 「先端FPGAにみるDSP実装の柔軟性」

第39回 「FPGAで実現する浮動小数点DSP」(前編)

第40回 「FPGAで実現する浮動小数点DSP」(後編)

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第42回 システムの要求に応える28nmFPGA(その2)〜28nmFPGAデザインにおける消費電力の最適化〜

第43回 組み込みシステム設計者のニーズに応える最新SoC FPGA(前編)

第44回 組み込みシステム設計者のニーズに応える最新SoC FPGA(後編)

第45回 最先端の28nmFPGAと最新のエンベデッド・ソリューション 〜ET2011リポート(前編)〜

第46回 最先端の28nmFPGAと最新のエンベデッド・ソリューション 〜ET2011リポート(後編)〜

第47回 システムの要求に応える28nm FPGA(その3) 〜パーシャル・リコンフィギュレーションの設計〜

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提供:日本アルテラ株式会社
アイティメディア営業企画/制作:EDN Japan 編集部/掲載内容有効期限:2014年3月31日

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